高通公司申请用于小芯片系统中的基于睡眠时钟边沿的全局计数器同步的系统和方法专利，实现全局计数器同步

金融界2024年3月22日消息，据国家知识产权局公告，高通股份有限公司申请一项名为“用于小芯片系统中的基于睡眠时钟边沿的全局计数器同步的系统和方法“，公开号CN117751337A，申请日期为2022年7月。

专利摘要显示，各种实施方案包括用于在多小芯片系统中提供基于睡眠时钟边沿的全局计数器同步的方法和系统。一种片上系统(SoC)可包括第一小芯片，该第一小芯片包括第一小芯片全局计数器子系统；以及第二小芯片，该第二小芯片包括第二小芯片全局计数器子系统。该SoC还可包括通信地耦合该第一小芯片和该第二小芯片的接口总线，以及被配置为向该第一小芯片和该第二小芯片提供睡眠时钟的功率管理集成电路(PMIC)。该第一小芯片可被配置为跨该接口总线将全局计数器同步脉冲触发传输到该第二小芯片。该第二小芯片可被配置为响应于接收该全局计数器同步脉冲触发来在该睡眠时钟的睡眠时钟同步边沿处将全局计数器同步值加载到该第二小芯片全局计数器子系统中。

本文源自金融界

一个厉害的芯片芯片74LS190同步计数器可以做加法也可以做减法

74LS190是同步十进制加/减计数器（又称可逆计数器），

漂亮的主板

它依靠加/减控制端的控制来实 现加法计数和减法计数。

CPU

CO/BO：进位输出/借位输出端；

CP：时钟输入端：

CT：计数控制端（低电平有效）；

Do~D3：并行数据输入端；

W：异步并行置入控制端（低电平有效）；

Qo~Q3：输出端；

RC：行波时钟输出端（低电平有效）；

U/D :加/减计数方式控制端。

下表为74LS190的状态表，从该表中可以看出，74LS190工作状态有4种：置数、 加计数、减计数和保持。

状态表

（1） 置数

74LS190置数（或称预置）是异步的。当置入控制端（LD非）为低电平时，不管时钟CP 端状态如何，输出端（Q0Q3）即可预置成与数据输入端（D0D3）相一致的状态。

（2） 计数

74LS190釆用同步计数方式。当CT非=O、 U非/D=0时进行加计数；当CT非=0 U非/D=l时 进行减计数。只有在CP为高电平时，UT非/和U非/D才可以跳变。

74LS190有超前进位功能。当计数上溢或下溢时，进位/借位输出端（CO/BO）输出一个 宽度约等于CP脉冲周期的高电平脉冲，行波时钟输出端（RC非）输出一个宽度等于CP低电 平部分的低电平脉冲。

（3） 保持

当LE非=1、CT非=1时，74LS190工作在保持状态，在该状态下，即使CP端输入时钟脉冲, 输出端（Q0Q3）数据也不会发生变化。

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