三星取得全加器集成电路、四输入复用器集成电路及其使用方法专利，改进集成电路的面积和功率

金融界2024年4月17日消息，据国家知识产权局公告，三星电子株式会社取得一项名为“全加器集成电路、四输入复用器集成电路及其使用方法“，授权公告号CN111147068B，申请日期为2019年7月。

专利摘要显示，公开全加器集成电路、四输入复用器集成电路及其使用方法。示例实施例提供一种用于改进集成电路(IC)的面积和功率的使用全加器集成电路(ADDF)的方法，包括：接收三个输入信号并生成三个相应的互补输出信号；使用生成的三个相应的互补输出信号中的两个互补输出信号和三个输入信号中的一个来生成内部信号；使用生成的三个相应的互补输出信号中的互补输出信号、生成的内部信号和生成的内部信号的互补内部信号来生成输出求和信号；以及使用生成的三个相应的互补输出信号中的两个互补输出信号、生成的内部信号和互补内部信号来生成进位信号。这里的示例实施例还提供一种用于减小IC的面积的四输入复用器集成电路(MXT4)。

本文源自金融界

清华大学申请基于全加器的存算架构专利，可极大减少全加器中晶体管的数量

金融界2024年1月10日消息，据国家知识产权局公告，清华大学申请一项名为“基于全加器的存算架构及智能存算处理器“，公开号CN117369767A，申请日期为2023年10月。

专利摘要显示，本申请涉及了一种全加器的存算架构及智能存算处理器，包括第一反相器、第二反相器、第三反相器、第四反相器以及第五反相器，也就是说通过10个晶体管就可以实现乘加运算，相比于现有技术中需要12个以上晶体管的全加器来实现乘加运算，极大地减少了全加器中晶体管的数量，进一步地，由该全加器级联而成的加法树所占面积也进一步降低，因此可以提高存储器芯片的面积效率。

本文源自金融界

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